现在的情况是SoC已经能够使用VCS仿真（确保核能够运行起来），也能够FPGA上板
那么如何对程序进行调试呢？就是使用keil+jlink的调试方式
注意注意注意！！！！
需要对FPGA的时钟进行约束，
因为vcs仿真的时候，时钟频率是50MHz，因此将FPGA的时钟同样约束到50MHz
接下来就是keil的配置，具体的明天再更新吧~~
详细解决方案
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